DE引脚必须由MCU软件精确控制，不能依赖硬件自动切换；MAX485/SP3485无方向自动检测功能，DE与RE需独立或严格时序协同控制，发送前置高DE、拉低RE，发送完成立即拉低DE并置高RE，推荐用TC中断而非固定延时触发切换。
DE引脚必须由MCU软件精确控制，不能靠硬件自动切换
485芯片（如MAX485、SP3485）本身不带方向自动检测功能，DE（驱动使能）和RE（接收使能）是两个独立控制信号。常见错误是把DE和RE短接后只用一个IO控制——这在发送末尾没及时拉低DE时，会导致总线冲突或接收异常。实际项目中必须分开控制，且DE高电平期间只能发，DE低电平+RE高电平才能收。
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DE和RE建议分别接不同GPIO，避免逻辑耦合；若资源紧张必须共用，需确保发送完成后有足够延时再切回接收（至少1–2字符时间） - 发送前先置高
DE（同时拉低RE），发送完成后再拉低DE并置高RE，中间无重叠 - 使用UART空闲中断或TX完成中断（如STM32的
TC标志）触发DE关闭，比固定延时更可靠
发送函数里必须嵌入DE控制逻辑，不能依赖外设自动管理
C++单片机代码里，UART外设本身不管485方向，DE控制必须显式插入到发送流程中。典型错误是写完HAL_UART_Transmit()就认为结束了，没关DE，导致后续节点无法抢占总线。
- 发送前：置高
DE，拉低RE（或保持RE为高，仅DE有效） - 调用阻塞式发送（如
HAL_UART_Transmit(&huart1, tx_buf, len, HAL_MAX_DELAY)） - 发送返回后：立即拉低
DE，并确保RE为高（进入接收态） - 若用DMA发送，必须在DMA传输完成回调（如
HAL_UART_TxCpltCallback）里关DE，不能在主函数里延时等待
接收时DE必须全程为低，且要防总线空闲干扰
485接收阶段DE必须稳定为低，否则芯片可能误驱动总线，破坏通信。另一个易忽略点是：当总线空闲时，A/B线处于高阻态，易受干扰产生虚假起始位。所以接收端需配合软件滤波或硬件上下拉。
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DE在进入接收状态前就应置低，且在整个接收周期（包括等待下一帧）保持低电平 - 推荐在UART初始化后立刻设置
DE = 0、RE = 1，之后只在发送前改DE - 若使用中断接收，务必检查
USART_SR_IDLE或空闲中断，避免因干扰导致连续进中断 - 硬件上在485芯片A/B引脚间加120Ω终端电阻，A接上拉、B接下拉（各约620Ω）可提升抗扰性
多节点通信时，DE切换时序决定是否丢帧或冲突
半双工意味着同一时刻只能有一个节点发。如果两个节点几乎同时开始发送，且DE切换不够快，就会发生总线竞争，表现为接收端收到乱码或校验失败。关键不是“谁先发”，而是“谁先完成DE开启并稳定输出”。
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- 发送前增加最小总线静默时间（如3.5个字符时间），确保前一帧完全结束
- 对主从结构，从机响应延迟必须包含
DE建立时间（通常 - 用示波器抓
DE和UART_TX波形，确认DE上升沿早于TX第一个下降沿至少1–2μs - 避免在中断里直接开
DE发数据——高优先级中断可能打断低优先级的DE关闭操作，造成状态错乱
DE关闭时机与UART物理层时序的匹配精度。哪怕只是晚关几百纳秒，在115200bps下也可能吃掉半个起始位，让下一个节点的接收同步失效。用逻辑分析仪看DE和TX/RX波形，比反复改延时更有效。 
