std::memory_order_release + acquire 能解决判断失效，因其通过同一原子变量 ready 建立 happens-before 关系：release 保证其前所有写（如 data）对其他线程可见且不重排，acquire 保证其后所有读（如 data）能看到这些写。
多线程中“判断失效”——比如 ready.load() == true 后读不到刚写入的 data 值，根本原因不是逻辑错，而是编译器或 CPU 把写 data 和写 ready 重排了，或者消费者读 ready 后没强制看到之前写 data 的结果。加内存屏障不是随便插一条 mfence 就行，得按语义配对用。
为什么 std::memory_order_release + acquire 能解决判断失效
这是最常用、开销最小、语义最清晰的方案。它不阻塞所有指令，只约束相关读写之间的可见性顺序。
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ready.store(true, std::memory_order_release)：保证该 store 之前的**所有写操作**（包括data.store(42, ...)）对其他线程可见，且不会被重排到这句之后 -
ready.load(std::memory_order_acquire)：一旦返回true，就保证该 load 之后的**所有读操作**（比如data.load(...)）能看到 release 之前的所有写 - 关键点：acquire 和 release 必须作用于**同一个原子变量**（这里是
ready），才能建立 happens-before 关系；单独对data加relaxed没问题，因为同步已由ready承担
什么时候必须用 std::atomic_thread_fence
当你没法把同步信号和数据绑在同一个原子变量上时——比如信号是普通布尔量、数据是多个非原子字段、或信号由别的机制（如信号量、eventfd）触发，就得手动插栅栏。
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- 生产者末尾加：
std::atomic_thread_fence(std::memory_order_release)，再写ready = true（普通写） - 消费者循环里，在读到
ready == true后、读数据前，加：std::atomic_thread_fence(std::memory_order_acquire) - 注意：
std::atomic_signal_fence不参与线程间同步，只防编译器重排，不能替代thread_fence - 错误做法：在普通变量读写之间插
mfence内联汇编——它可能被编译器优化掉，或与原子操作语义不匹配
容易踩的坑：relaxed 用错、编译器重排漏防、x86 假安全感
x86 的 StoreLoad 重排极少发生，所以很多人在 x86 上测试没问题，一换 ARM 或 RISC-V 就崩。这不是硬件 bug，是弱内存模型的正常行为。
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data.store(42, std::memory_order_relaxed)单独用没问题，但若前面没 release、后面没 acquire，它就真的“松散”——可能永远不被其他线程看到 - 即使用了
release/acquire，如果ready是普通bool而非std::atomic<bool></bool>，整个同步链就断了：原子性是前提，顺序性是附加保证 - GCC/Clang 默认会做编译期重排，
asm volatile ("" ::: "memory")只能防编译器，不能替代 CPU 屏障；而std::atomic_thread_fence同时抑制两者
真正要命的不是记不住四种屏障类型，而是忘了：屏障必须成对出现、作用于同一同步点、且原子变量本身必须声明为 std::atomic。少一个条件，多线程判断就可能在某个 CPU 架构、某个编译器版本、某次负载波动下突然失效。
