异常处理器汇编指令布局优化的核心是提升中断响应路径的稳定性、速度与可预测性，需通过64字节对齐异常入口、纯汇编精简入口、数据代码分离及向量表预热等手段实现。
异常处理器的汇编指令布局优化，本质是让中断响应路径（从异常向量跳转到服务例程入口）在硬件层面跑得最稳、最快、最可预测。这不是靠堆指令数量，而是靠对流水线、缓存、分支预测和内存访问时序的精准控制。
异常入口必须紧贴向量表且零等待
ARM Cortex-M等主流内核的异常向量表是固定地址、每项4字节，存放的是服务例程入口地址。CPU检测到异常后，会自动跳转——但这个“跳”不是无代价的。如果目标地址不在指令缓存中，或跨了缓存行边界，就会触发取指停顿。
关键做法：
- 将每个异常处理函数（如
NMI_Handler、HardFault_Handler）的第一条指令严格对齐到64字节边界（L1指令缓存行大小） - 确保整个处理函数体（尤其是前16–32字节）能被单次预取加载，避免中途因缓存未命中而卡在IF阶段
- 在链接脚本中用
ALIGN(64)约束段位置，而非依赖编译器默认布局
消除入口处的隐式开销
Miller CSV TSV JSON 数据处理器
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Miller (mlr) 是一个命令行工具，用于查询、整形和重新格式化名称索引数据，如 CSV、TSV、JSON 和 JSON Lines。它将 awk、sed、cut、join 和 sort 的功能整合到一个专为结构化数据处理而构建的单一工具中。
很多C写法生成的异常处理函数开头会插入栈保存、寄存器压栈、函数帧建立等指令，这在毫秒级实时场景里就是延迟黑洞。
推荐方式：
- 用纯汇编编写最简入口（
.global HardFault_Handler），只做三件事：保存必要上下文（如PUSH {r0-r3, r12, lr}）、跳转到C函数、返回时不恢复全部寄存器（由C函数自己管理） - 避免在汇编入口调用
bl跳转到C函数后再pop——改用b直接跳，并让C函数以__attribute__((naked))声明，禁止编译器自动生成进出栈代码 - 若需快速响应（如定时器溢出中断），甚至可禁用浮点寄存器自动保存（通过SCB->AIRCR配置
PRIGROUP与BFHFNMINS位），省下数十周期
数据与代码分离，防止D-Cache污染I-Cache
异常处理中常需查表（如错误码映射）、读状态寄存器、写控制寄存器。若这些常量数据和指令混在同一个64字节块里，一次数据访问可能触发整行I-Cache失效。
实操建议：
- 所有异常处理用到的只读数据（如字符串提示、错误码数组）统一放在
.rodata段，并用__attribute__((section(".exception_rodata")))显式隔离 - 启用D-Cache时，确保这些数据不与代码段物理相邻；必要时在链接脚本中插入
> REGION_FLASH AT> REGION_FLASH偏移空隙 - 对关键状态寄存器读写，用
volatile+内存屏障（如__DMB()），防止编译器重排破坏时序
向量表本身也要“预热”
ART加速器或类似指令预取单元，对向量表这种小而高频访问的区域特别敏感。但默认情况下，向量表可能被分散在Flash不同页中。
优化动作：
- 在启动代码中，将向量表复制到SRAM中执行（尤其适用于支持重映射的MCU），并确保SRAM起始地址对齐64字节
- 若必须原地运行，用
__attribute__((section(".isr_vector")))强制向量表独占一个独立section，并在链接脚本中指定其位于Flash首地址（0x08000000），使其天然落入ART预取缓冲区首行
不复杂但容易忽略
