CAS的原子性由CPU硬件指令直接保障，Java通过Unsafe类调用JVM底层Atomic::cmpxchg函数，在x86上生成lock cmpxchg指令，现代CPU优先依赖MESI缓存一致性协议实现缓存锁，仅在跨缓存行或不可缓存时退化为总线锁。
CAS（Compare-And-Swap）在 Java 中并非直接调用 CPU 的 cmpxchg 指令，而是通过 JVM 底层的原子类（如 Unsafe.compareAndSwapInt）间接触发，其硬件实现依赖于 x86 架构下的 cmpxchg 指令——该指令天然具备原子性，但具体如何保证多核一致性，关键不在于“总线锁”或“缓存锁”的显式选择，而在于 CPU 对该指令执行时的自动协同机制。
cmpxchg 本身不主动加锁，靠硬件协议保障原子性
cmpxchg 是一条带有隐含锁语义的指令：当它被用于内存操作（如 cmpxchg [rax], ebx）时，CPU 会在执行期间自动确保该内存地址的读-改-写过程不被其他核心中断。这种保证不是靠软件申请“总线锁”，也不是程序员手动控制“缓存锁”，而是由 CPU 微架构和缓存一致性协议（如 MESI）协同完成：
- 若目标地址所在缓存行处于本核的 Exclusive 或 Modified 状态，
cmpxchg可直接在本地缓存完成，无需总线信号——这等效于“缓存锁”效果； - 若该缓存行在其他核上为 Shared 或 Invalid，CPU 会通过 MESI 协议发起总线/互连请求（如 RFO，Request For Ownership），强制其他核将对应缓存行置为 Invalid，再独占写入——这个过程对上层透明，但本质是缓存一致性协议驱动的“缓存行级锁定”；
- 只有在极老的奔腾或不支持缓存一致性的系统中，才可能退化为真正阻塞整条总线的
LOCK#信号（即传统“总线锁”），现代 x86 CPU 几乎从不这么做。
JVM 的 Unsafe 实现桥接了指令与平台差异
Java 程序无法直接发出 cmpxchg，而是调用 Unsafe.compareAndSwapXxx 方法。JVM 在不同 CPU 架构上生成对应汇编：
- x86_64 下，HotSpot JVM 编译后实际生成带
lock cmpxchg前缀的指令（lock前缀确保指令在多核下原子执行，并触发缓存一致性协议）； - ARM 或 AArch64 下，则使用
ldaxr/stlxr这类加载-存储排他指令对，配合底层 exclusive monitor 实现等价语义； - JVM 层屏蔽了这些细节，开发者只需关注逻辑正确性，不用关心锁粒度是总线还是缓存行。
为什么不会出现“两个核心同时成功 CAS”？
根本原因在于 cmpxchg 是 CPU 提供的原子读-改-写原语：它把“读取旧值、比较是否相等、写入新值”三步压缩为一个不可分割的操作。即使两个核心在同一纳秒发起对同一地址的 cmpxchg，硬件也会串行化执行——其中一个获得缓存行所有权并成功，另一个因缓存行状态冲突而失败（返回 false）。这不是靠锁排队，而是靠缓存一致性协议+指令原子性双重保障。
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应用层需注意：CAS 成功 ≠ 业务逻辑无竞争
虽然 cmpxchg 本身绝对原子，但 Java 中基于它的并发结构（如 AtomicInteger.incrementAndGet()）仍可能因“ABA 问题”或“循环时间过长”导致逻辑错误。例如：
- 一个线程读到值 A，被调度挂起；另一线程将 A→B→A；原线程恢复后 CAS 成功，但业务状态已非预期；
- 高竞争下 CAS 失败重试频繁，造成大量无效 CPU 循环，此时应考虑分段锁、LongAdder 等替代方案。
本质上，CAS 的高效源于硬件对单个内存地址的原子操作支持，而现代多核 CPU 已将“锁”的开销收敛到缓存行级别，不再依赖低效的总线争抢。理解这一点，就能明白为何无锁编程可行，也清楚何时该跳出 CAS 思维去设计更合适的并发模型。
