memory_order_relaxed仅适用于无需同步其他内存操作的场景，如计数器、引用计数、生成唯一ID；不可用于发布-订阅或保护共享数据，且在ARM上更易出错。
memory_order_relaxed 什么时候能用
只关心原子变量本身的读写不被重排，但不关心它和其他内存操作的顺序时，才能用 memory_order_relaxed。典型场景是计数器、引用计数、生成唯一 ID —— 这些操作只要值正确，不需要同步其他数据。
常见错误现象：std::atomic<int> counter{0};</int> 用 memory_order_relaxed 做自增，结果在多线程下看到值“跳变”或“回退”，其实不是原子性问题，而是你误以为它能保证观察到其他变量的最新状态。
- 不能用于发布-订阅模式（比如 flag 变量 + 数据缓冲区）
- 不能替代锁来保护结构体字段的可见性
- 在 ARM/AArch64 上，
relaxed指令可能比 x86 更“松”，跨平台时尤其容易出错
memory_order_acquire 和 release 配对怎么写才不漏
这是最常写错的一对：必须在同一个原子变量上，由不同线程分别用 memory_order_acquire（读）和 memory_order_release（写），才能构成“synchronizes-with”关系，从而让 release 之前的所有写入对 acquire 之后的读取可见。
常见错误现象：用 load(memory_order_acquire) 读一个 flag，但写 flag 时用了 store(val, memory_order_relaxed)，结果另一线程永远看不到新数据；或者两个线程都用 acquire，没配对。
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- 写 flag 必须用
memory_order_release或更强（如seq_cst） - 读 flag 必须用
memory_order_acquire或更强 - 不能混用变量：A 线程写
flag1，B 线程读flag2，再强的序也没用
memory_order_seq_cst 是默认值，但真需要它吗
90% 的 C++ 开发者写的原子操作，默认就是 memory_order_seq_cst，因为它最安全、最容易理解。但它代价高：在 x86 上虽基本免费（靠硬件保证），但在 ARM/PowerPC 上会插入全局内存屏障，影响性能；更重要的是，它强制所有线程看到完全一致的操作顺序，有时会掩盖真正的问题。
使用场景：你需要“全局顺序一致”语义，比如实现自旋锁、无锁队列头尾指针同步、或者调试阶段想先跑通逻辑。
- 如果只是单生产者单消费者，
acq_rel就够了 - 如果多个线程只读一个原子变量（如配置开关），
acquire足够 - 过度使用
seq_cst可能让 bug 更难复现——因为它的强约束掩盖了实际的数据竞争
编译器重排和 CPU 重排到底谁在捣鬼
选错内存序，往往不是因为不懂 CPU 指令，而是忽略了编译器优化。比如 load(memory_order_acquire) 能阻止编译器把其后的普通读移到前面，但不能阻止编译器把其前的普通写移到后面——除非你用 release 配对。
常见错误现象：代码在 debug 模式下正常，release 下崩溃；或者在 x86 上跑得好好的，一上 ARM 就出问题。这时候大概率是编译器重排+CPU 重排双重作用的结果。
-
acquire禁止其后的读/写被重排到它前面 -
release禁止其前面的读/写被重排到它后面 -
acq_rel同时具备两者效果（如fetch_add） - 不要依赖“x86 不重排写-读”，那是硬件特性，不是语言保证
真正难的不是记住六种序，而是画出那个 happens-before 图：哪一行代码必须在哪个原子操作之前完成，且这个约束要对所有线程成立。没画图就写内存序，基本等于蒙。
